Détails du produit
Le Foxboro FCP280 (RH924YL) sert de FCP280 principal, utilisé pour exécuter les communications d’E/S de procédé et la logique de contrôle sur les plateformes DCS Foxboro I/A Series. Doté d’une architecture ARM System on a Chip (SOC), il coordonne 128 Mo de SDRAM et 128 Mo de mémoire Flash avec une détection des erreurs au niveau matériel. Le module prend en charge l’ECC pour la correction des erreurs sur un seul bit et la détection des erreurs sur plusieurs bits, assurant des échanges de données de procédé hautement fiables via des boucles utilisant le protocole HDLC.
Spécifications matérielles
| Paramètre | Spécification |
|---|---|
| Modèle | FCP280 (RH924YL) |
| Marque | Foxboro |
| Origine | Consulter l’usine |
| Dimensions | Format standard de plaque de base à montage horizontal |
| Température de fonctionnement | 0 °C à 60 °C |
| Consommation électrique | Rails d’alimentation nominaux du fond de panier DCS |
| Type de processeur | ARM System on a Chip (SOC) |
| Allocation mémoire | 128 Mo de SDRAM, 128 Mo de mémoire Flash |
| Détection des erreurs | ECC (correction sur un bit, détection sur plusieurs bits) |
| Protocole de bus de terrain | HDLC |
| Débit de transmission | 2 Mbit/s (FBM de la série 200), 268 kbit/s (FBM de la série 100) |
| Capacité d’E/S | Jusqu’à 128 FBM au total sur les ports de bus de terrain étendus |
| Blocs d’allocation mémoire | OLUG classique : 15,75 Mo, OLUG amélioré : 19,75 Mo |
Connectivité FOUNDATION Fieldbus et Profibus PA
L’architecture prend en charge l’intégration transparente d’instruments de terrain distribués grâce à des liaisons de communication de procédé à haute intégrité. En s’appuyant sur les cadres de connectivité normalisés FOUNDATION Fieldbus et Profibus PA ainsi que sur les boucles HDLC, le processeur assure un transfert de données déterministe sur des réseaux FBM mixtes des séries 100 et 200. L’isolation au niveau des canaux et la planification robuste du bus de fond de panier réduisent le délai de propagation et maintiennent une synchronisation temporelle stricte pour les applications de commande en boucle fermée.
Questions fréquemment posées
Q : Quelles sont les limites d’allocation mémoire pour les blocs OLUG classiques et améliorés sur le FCP280 ?
R : Le processeur alloue 15,75 Mo aux blocs OLUG classiques et 19,75 Mo aux blocs OLUG améliorés au sein de son sous-système SDRAM de 128 Mo.
Q : Comment le FCP280 gère-t-il les débits de transmission sur des architectures FBM mixtes des séries 100 et 200 ?
R : Il prend en charge les communications HDLC à double débit, fonctionnant à 2 Mbit/s pour les FBM de la série 200 et à 268 kbit/s pour les FBM de la série 100, et prend en charge jusqu’à 128 nœuds FBM au total répartis sur les ports de bus de terrain étendus.
Q : Le processeur intègre-t-il des mécanismes de contrôle des erreurs mémoire ?
R : Oui, il utilise un code de correction d’erreur (ECC) au niveau matériel pour corriger les erreurs sur un seul bit et détecter les erreurs sur plusieurs bits dans les matrices de mémoire intégrées.
Consignes d’installation sur site
Assurez-vous que la plaque de base à montage horizontal est solidement fixée à un rail DIN mis à la terre ou à une surface de panneau avant d’insérer le module. Vérifiez que toutes les alimentations sont hors tension avant de manipuler le matériel du processeur afin d’éviter tout dommage transitoire au bus de fond de panier. Maintenez un blindage et une mise à la terre appropriés pour tous les câbles de communication HDLC afin de réduire les interférences électromagnétiques dans les environnements industriels. Vérifiez l’alignement broche à broche avant d’installer le module dans le connecteur du fond de panier.
Informations supplémentaires
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