Détails du produit
Présentation du produit
Le Triconex AP3101 sert de moteur de calcul principal pour le système de sécurité Tricon Triple Modular Redundancy (TMR). Ce module processeur principal haute performance exécute les applications de contrôle de l’utilisateur, gère le traitement complexe des signaux E/S et maintient la synchronisation du système à travers les canaux tripliés. En utilisant une architecture Motorola PowerPC 32 bits double, il offre l’exécution déterministe requise pour les boucles de sécurité SIL-3 dans les installations pétrolières, gazières et de production d’énergie. Nous fournissons ce module en tant que équipement 100 % neuf et original, scellé en usine.
Spécifications techniques
| Composant / Fonctionnalité | Détails des spécifications |
| Processeur d’application (SX) | Motorola MPC860, 32 bits, 50 MHz |
| Processeur E/S (IOx) | Motorola MPC860, 32 bits, 50 MHz |
| Flash PROM | 6 Mo (stockage protégé par CRC) |
| DRAM (SX & IOx) | 16 Mo chacun (avec parité par octet) |
| NVRAM | 8 Ko (variables protégées par CRC) |
| Mémoire partagée | 128 Ko (parité par octet activée) |
| Bus de diagnostic | HDLC 2 Mbps |
| Tension d’entrée nominale | 24 VCC |
| Plage de fonctionnement | 19,2 VCC à 30,0 VCC |
| Consommation électrique | 8 Watts (maximum) |
| Poids | 1,5 kg |
Avantages techniques
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Architecture dédiée à double processeur : Le AP3101 sépare la logique applicative de la gestion des E/S en utilisant des processeurs Motorola MPC860 SX et IOx indépendants. Cette répartition des tâches évite que la surcharge de communication E/S ne retarde l’exécution de la logique de sécurité critique, garantissant des vitesses de traitement constantes de 50 MHz même en cas de trafic E/S dense.
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Protection des données en triple couche : Le module utilise des contrôles de redondance cyclique (CRC) pour la Flash et la NVRAM, combinés à une parité par octet pour la DRAM. Cette approche multicouche détecte immédiatement toute corruption mémoire, empêchant l’exécution d’une logique défectueuse pouvant entraîner une défaillance catastrophique du processus.
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Bus de diagnostic déterministe : Un bus de diagnostic HDLC dédié à 2 Mbps transfère les informations de santé des modules E/S entre les canaux du processeur principal. Ce chemin isolé permet au système TMR de synchroniser les données de défaut sur les trois processeurs principaux sans consommer la bande passante de l’application principale.
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Régulation d’alimentation robuste : Le circuit logique fonctionne sur une large plage de 24 VCC (-15 % à +20 %) et tolère jusqu’à 5 % de ondulation alternative. Cette résilience électrique permet au AP3101 de maintenir sa stabilité lors des fluctuations industrielles d’alimentation ou en fonctionnement à proximité de machines électriques lourdes.
Questions fréquentes
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Comment le AP3101 maintient-il la sécurité si un processeur tombe en panne ?
Le AP3101 fonctionne dans le cadre du système Tricon TMR. Si les diagnostics internes détectent une défaillance du processeur d’un canal, les deux autres processeurs principaux continuent d’exécuter la logique et surpassent l’unité défectueuse par vote. Ce mécanisme de vote 2 sur 3 (2oo3) garantit un contrôle de sécurité ininterrompu.
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Quelle est l’importance de la Flash PROM de 6 Mo ?
La Flash PROM stocke la logique SX, IOx et l’application de contrôle. Sa protection CRC garantit que le logiciel reste intact lors du stockage à long terme ou en conditions de forte interférence, assurant que le processeur démarre toujours dans un état de sécurité valide.
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Ce module supporte-t-il le remplacement à chaud ?
Oui. Vous pouvez remplacer un module AP3101 pendant que le système Tricon est sous tension et que les deux autres processeurs principaux contrôlent le processus. Le nouveau module synchronise automatiquement sa mémoire et son état logique avec les processeurs actifs dès son insertion.
Informations supplémentaires
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