{"product_id":"honeywell-2mlr-cpuh-t-masterlogic-200-high-speed-cpu-module-1","title":"हनीवेल 2MLR-CPUH\/T मास्टरलॉजिक-200 हाई स्पीड सीपीयू मॉड्यूल","description":"\u003cp\u003e\u003cstrong\u003eHoneywell 2MLR-CPUH\/T\u003c\/strong\u003e, जिसे \u003cstrong\u003e2MLR-CPUH\u003c\/strong\u003e हाई स्पीड CPU मॉड्यूल के रूप में भी सूचीबद्ध किया गया है, MasterLogic-200 प्लेटफ़ॉर्म के भीतर नियतात्मक प्रोग्राम निष्पादन और I\/O स्कैन प्रबंधन के लिए एक समर्पित हार्डवेयर घटक के रूप में कार्य करता है।\u003c\/p\u003e\n\u003ch3\u003eहार्डवेयर विनिर्देश\u003c\/h3\u003e\n\u003cfigure class=\"table\"\u003e\n\u003ctable\u003e\n\u003cthead\u003e\n\u003ctr\u003e\n\u003cth\u003e\u003cstrong\u003eपैरामीटर\u003c\/strong\u003e\u003c\/th\u003e\n\u003cth\u003e\u003cstrong\u003eविनिर्देश\u003c\/strong\u003e\u003c\/th\u003e\n\u003c\/tr\u003e\n\u003c\/thead\u003e\n\u003ctbody\u003e\n\u003ctr\u003e\n\u003ctd\u003eमॉडल\u003c\/td\u003e\n\u003ctd\u003e2MLR-CPUH\/T\u003c\/td\u003e\n\u003c\/tr\u003e\n\u003ctr\u003e\n\u003ctd\u003eब्रांड\u003c\/td\u003e\n\u003ctd\u003eHoneywell\u003c\/td\u003e\n\u003c\/tr\u003e\n\u003ctr\u003e\n\u003ctd\u003eमूल देश\u003c\/td\u003e\n\u003ctd\u003eदक्षिण कोरिया\u003c\/td\u003e\n\u003c\/tr\u003e\n\u003ctr\u003e\n\u003ctd\u003eवज़न\u003c\/td\u003e\n\u003ctd\u003e0.257 kg\u003c\/td\u003e\n\u003c\/tr\u003e\n\u003ctr\u003e\n\u003ctd\u003eआयाम\u003c\/td\u003e\n\u003ctd\u003eमानक MasterLogic-200 CPU मॉड्यूल फॉर्म फ़ैक्टर\u003c\/td\u003e\n\u003c\/tr\u003e\n\u003ctr\u003e\n\u003ctd\u003eऑपरेटिंग तापमान\u003c\/td\u003e\n\u003ctd\u003e0 से 55 deg C\u003c\/td\u003e\n\u003c\/tr\u003e\n\u003ctr\u003e\n\u003ctd\u003eपावर खपत\u003c\/td\u003e\n\u003ctd\u003e5 VDC पर 1173 mA (आंतरिक बैकप्लेन)\u003c\/td\u003e\n\u003c\/tr\u003e\n\u003ctr\u003e\n\u003ctd\u003eप्रोग्राम मेमोरी\u003c\/td\u003e\n\u003ctd\u003e7 MB\u003c\/td\u003e\n\u003c\/tr\u003e\n\u003ctr\u003e\n\u003ctd\u003eफ़्लैश मेमोरी\u003c\/td\u003e\n\u003ctd\u003e16 MB\u003c\/td\u003e\n\u003c\/tr\u003e\n\u003ctr\u003e\n\u003ctd\u003eप्रोग्राम निष्पादन विधियाँ\u003c\/td\u003e\n\u003ctd\u003eचक्रीय स्कैन, समय-आधारित इंटरप्ट, आंतरिक मेमोरी इंटरप्ट\u003c\/td\u003e\n\u003c\/tr\u003e\n\u003ctr\u003e\n\u003ctd\u003eI\/O नियंत्रण विधि\u003c\/td\u003e\n\u003ctd\u003eस्कैन-सिंक्रोनस बैच प्रोसेसिंग I\/O (रिफ़्रेश विधि), प्रोग्राम निर्देश द्वारा डायरेक्ट I\/O विधि\u003c\/td\u003e\n\u003c\/tr\u003e\n\u003ctr\u003e\n\u003ctd\u003eप्रोग्रामिंग भाषाएँ\u003c\/td\u003e\n\u003ctd\u003eलैडर डायग्राम, सीक्वेंशियल फ़ंक्शन चार्ट, स्ट्रक्चर्ड टेक्स्ट, इंस्ट्रक्शन लिस्ट (केवल देखने के लिए)\u003c\/td\u003e\n\u003c\/tr\u003e\n\u003ctr\u003e\n\u003ctd\u003eअधिकतम I\/O क्षमता\u003c\/td\u003e\n\u003ctd\u003e31 I\/O बेस, 372 स्लॉट, 128,000 नेटवर्क\/रिमोट I\/O पॉइंट\u003c\/td\u003e\n\u003c\/tr\u003e\n\u003c\/tbody\u003e\n\u003c\/table\u003e\n\u003c\/figure\u003e\n\u003ch3\u003eप्रोसेस कंट्रोल एकीकरण और फ़ील्डबस प्रोसेसिंग\u003c\/h3\u003e\n\u003cp\u003e2MLR-CPUH\/T, 128,000 फ़ील्ड नेटवर्क और रिमोट I\/O चैनलों में कंट्रोल लॉजिक के रियल-टाइम निष्पादन को संभालता है। बैकप्लेन चेसिस में एकीकृत 4-20 mA HART लूप प्रोटोकॉल फ़ील्ड डिवाइस, FOUNDATION Fieldbus और Profibus PA नेटवर्क गेटवे के माध्यम से कार्य करते हुए, प्रोसेसर लॉजिक निष्पादन को फ़ील्ड शोर से अलग रखता है। आंतरिक निष्पादन रूटीन 7 MB प्रोग्राम RAM और 16 MB नॉन-वोलेटाइल फ़्लैश मेमोरी का उपयोग करके चैनल-दर-चैनल आइसोलेशन और फ़ॉल्ट डायग्नोस्टिक्स बनाए रखते हुए सब-मिलीसेकंड टास्क टाइमिंग प्रदान करते हैं।\u003c\/p\u003e\n\u003ch3\u003eअक्सर पूछे जाने वाले प्रश्न\u003c\/h3\u003e\n\u003cp\u003eप्रश्न: 2MLR-CPUH\/T CPU मॉड्यूल द्वारा समर्थित प्राथमिक प्रोग्राम निष्पादन विधियाँ कौन-सी हैं?\u003c\/p\u003e\n\u003cp\u003eउत्तर: मॉड्यूल चक्रीय स्कैन प्रोसेसिंग, समय-आधारित इंटरप्ट और आंतरिक मेमोरी इवेंट इंटरप्ट के माध्यम से प्रोग्राम लॉजिक निष्पादित करता है।\u003c\/p\u003e\n\u003cp\u003eप्रश्न: निष्पादन चक्रों के दौरान प्रोसेसर I\/O अपडेट को कैसे संभालता है?\u003c\/p\u003e\n\u003cp\u003eउत्तर: यह स्कैन-सिंक्रोनस बैच प्रोसेसिंग (मानक मेमोरी रिफ़्रेश विधि) और सॉफ़्टवेयर निर्देशों द्वारा सीधे ट्रिगर किए गए डायरेक्ट I\/O रिफ़्रेश, दोनों का समर्थन करता है।\u003c\/p\u003e\n\u003cp\u003eप्रश्न: 2MLR-CPUH\/T मॉड्यूल की बैकप्लेन करंट आवश्यकता क्या है?\u003c\/p\u003e\n\u003cp\u003eउत्तर: यूनिट 5 VDC बैकप्लेन बस रेल से नाममात्र 1173 mA करंट लेती है।\u003c\/p\u003e\n\u003ch3\u003eफ़ील्ड इंस्टॉलेशन दिशानिर्देश\u003c\/h3\u003e\n\u003col\u003e\n\u003cli\u003e2MLR-CPUH\/T प्रोसेसर मॉड्यूल को लगाने या हटाने से पहले बेस चेसिस रैक को बिजली देने वाले सभी सिस्टम पावर स्रोतों को अलग और डिस्कनेक्ट करें।\u003c\/li\u003e\n\u003cli\u003eरियर सर्किट कार्ड के गाइड पिन को बैकप्लेन स्लॉट के गाइड चैनलों के साथ संरेखित करें और मॉड्यूल को अपनी जगह पर मजबूती से बैठाएँ, जब तक कि ऊपर और नीचे के लॉकिंग लीवर लैच न हो जाएँ।\u003c\/li\u003e\n\u003cli\u003eशील्डेड, ट्विस्टेड-पेयर केबल असेंबली का उपयोग करके हाई-स्पीड कम्युनिकेशन इंटरफ़ेस को निर्दिष्ट फ्रंट-पैनल कनेक्टर से जोड़ें।\u003c\/li\u003e\n\u003cli\u003eसत्यापित करें कि रैक माउंटिंग फ़्रेम लो-इम्पीडेंस ग्राउंड वायर का उपयोग करके सीधे पैनल एनक्लोज़र के केंद्रीय अर्थिंग बार से जुड़ा है, ताकि प्रोसेसर इलेक्ट्रॉनिक्स को हाई-फ़्रीक्वेंसी इंटरफ़ेरेंस से सुरक्षित रखा जा सके।\u003c\/li\u003e\n\u003c\/ol\u003e","brand":"Honeywell","offers":[{"title":"Default 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